[参考译文] UCD3138：UCD3138的前端增益和测量分辨率问题

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https://e2e.ti.com/support/power-management-group/power-management/f/power-management-forum/679968/ucd3138-front-end-gain-and-measurement-resolution-issues-for-the-ucd3138

器件型号：UCD3138

你好
我正在学习 UCD3138 全桥硬开关开发板固件
我对 void init_front_end0 (void)有一些问题

void init_front_end0 (void)
｛

FeCtrl0Regs.EADCCTRL.bit.AFE_GAIN = 3；

｝

我知道这句话是为了将 AFE 的增益设置为8、将测量分辨率设置为1mV、

但我不确定为什么增益设置为8、而不是4、2和1。这是为什么？哪些因素决定增益和测量分辨率。

7 年多前

0 admin 7 年多前

TI__Guru**** 2463470 points

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这是通过在"最佳环路响应"和"噪声灵敏度"之间进行权衡来设置的。
增益 og 8可提供最佳输入分辨率、因此可提供最佳环路响应。但它也可能导致对噪声的额外敏感性。
如果您具有良好的布局并将噪声与输出级隔离、则增益8应该是更好的选择。

0 admin 7 年多前

TI__Guru**** 2463470 points

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明白了！谢谢！
ZJYL

0 admin 7 年多前

TI__Guru**** 2463470 points

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我找到了
FeCtrl0Regs.EADCCTRL.bit.AFE_GAIN = 3；
FeCtrl1Regs.EADCCTRL.bit.AFE_GAIN = 3；
FeCtrl2Regs.EADCCTRL.bit.AFE_GAIN = 0；
为什么要将 Vo 和 IO 环路的增益设置为8、并将 Vin 环路的增益设置为1？
与 Vo 和 IO 相比、Vin 信号是否不稳定？ Vin 的干扰信号是否更多？

0 admin 7 年多前

TI__Guru**** 2463470 points

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与 Vo、IO 的设置相比、Vin 的设置也存在差异
FeCtrl0Regs.EADCCTRL.bit.SCFE_CLK_DIV_2=0；
FeCtrl1Regs.EADCCTRL.bit.SCFE_CLK_DIV_2 = 0；
FeCtrl2Regs.EADCCTRL.bit.SCFE_CLK_DIV_2=1；
为什么 Vo、IO 设置为128nesEADC 转换一次、Vin 设置为64ns 转换一次。
原因是什么？