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[参考译文] TLC5925:LE 引脚的设置/保持要求

Guru**** 2387080 points
Other Parts Discussed in Thread: TLC5925, TLC59283
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/power-management-group/power-management/f/power-management-forum/1292434/tlc5925-setup-hold-requirement-for-le-pin

器件型号:TLC5925
主题中讨论的其他器件: TLC59283

您好!

我的客户有一个有关 TLC5925的问题。
从数据表(SLVS765B、P9)中的 Fugyre 1可以看出、LE 不需要 CLK 信号。
但在 P8和图5中、保持时间(th (L))和建立时间(tsu (+))指定为5ns 最小值。

为什么 指定到 CLK 的保持和设置时间? 这意味着什么?

此致、
奥巴

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    您好、Oba:

    LE 是数据选通信号输入。 当 LE 为高电平时、串行数据被传输到各自的锁存器。 所以、它需要保持时间和设置时间。

    BR、Jared

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    您好、Jared:

    感谢您的答复。
    下面是来自数据表的。 从图中可以看出、LE 运行不需要任何 CLK。
    这个数字是错的吗?

    此致、
    奥巴

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    您好、Oba:

    它不需要任何 CLK、只需要切换以锁存串行数据。

    BR、Jared

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    您好、Jared:

    我迷路了


    。 如果不需要 CLK、为什么需要对 CLK 进行设置/保持? 此致、 奥巴
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    您好、Oba:

    我不知道你的关切是什么。 在我看来、保持时间用于器件识别高电平、设置时间用于切换操作。 BTW、该规格仅标记为最小值、我认为这是内部振荡器的限制。 您能告诉我您有什么疑虑吗?

    BR、Jared

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    您好、Jared:

    好的、让我再解释一下。

    设置和保持定义如下图所示(来自数据表、图5)。

    设置为 CLK-Risign 到 LE FALLING。 保持时间为下一个 LE 下降到下一个 CLK 上升。
    如果 LE 与 CLK 无关、为什么需要这个设置/保持? 此参数的目的是什么?
    我无法理解。


    在下图(数据表中的图6)中、正如您所说、LE 看起来与 CLK 无关。
    只有 CLK-15接近 LE 高电平脉冲。 图中是蓝色的设置吗?
    是否需要进行此设置以确保 CLK0-15期间的所有 SDI 值在此时序中正确锁存?
    图中还显示了"保持"红色吗? 是否需要保持以确保由下一个 CLK-0计时的 SDI 信号不会错误锁存?




    此致、
    奥巴

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    您好、Oba:

    很抱歉,我没有注意到时间与 CLK 有关,因为我以前理解所有 TLC 串行接口都具有相同的逻辑。

    我曾尝试使用 TLC59283并一直将 LE 向上拉、操作方法没有任何问题。 请给我一些时间与我们的设计人员一起检查此规格、我会尽快回复您。

    BR、Jared

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    您好、Jared:

    您有任何更新吗?

    此致、
    奥巴

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    您好、Oba:

    我们的专家稍后会回复您。

    Br

    帕特里克

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    您好、Oba:

    很抱歉错过了、我要与设计人员查看此规格、最迟明天会给您回复。

    BR、Jared

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    您好、Oba:

    很抱歉、在与设计人员讨论后、我们认为它应该与 CLK 信号同步。

    BR、Jared

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    您好、Jared:

    感谢您的检查。
    但对我来说还不清楚。
    在这种情况下、"与 CLK 信号同步"是什么意思?
    以下理解是否正确?

    此致、
    奥巴

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    您好、Oba:

    我建议遵循以下结构、这意味着您需要遵循 t_h (L)、t_su (L)和 t_w (L)。

    BR、Jared