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器件型号：TPS629206 您好、TI 工程师、
我正在使用输入电压为12Vdc、输出电压为5Vdc 的 PSPICE 模型进行仿真、但输出电压不是12v、这是我第一次使用 PSpice、设置是否有问题？
我已经确认电路板上的实际电路的输出电压是5V。
尊敬的 Onishi：
您的仿真结果看起来很奇怪。
我采用相同的设置和结果如下所示。 输出电压为正常的5V。
您能否将仿真波形作为我的波形附上？
BTW、您选择的频率为1M、电感器为3.3uH。 电感器电流纹波的计算公式为(Vin-Vout)* Vout/Vin/L/FSW=0.884A。 此外、您设置的输出电流为5/(3.3/0.6)=0.91A、但 TPS62906是一个600mA 器件。 它可能会触发过流保护、因此我不建议您在此应用中使用3.3uH 电感器。
您好、TI 工程师、
感谢您的调查。
首先、VIN 电源直流电压是否正确？
在您提供的图形中、出现了延迟、您是否正在使用脉冲电源？
但波形看起来是直流的。
我不确定1MHz 设置项的位置、您能告诉我吗？
我还将连接波形。
如果不知道如何更改背景颜色、可能很难看到。 抱歉。
至于输出电流、负载在实际运行中绝不会流过600mA。 感谢您的建议。
尊敬的 Onishi：
是的、我使用了脉冲电源。
实际上、我在 TI.com 上刚刚使用了 TPS629206的 PSPICE for TI 模型、并按以下文件更改电阻器。
e2e.ti.com/.../TPS629206_5F00_PSPICE_5F00_TRANS.zip
您可以尝试运行该仿真、看看有什么区别。
您是否编辑了仿真设置？ 您可以直接向我发送仿真文件。
至于频率、您选择11k+6.8k=17.8k 模式电阻器、这样每个数据表的频率就为1MHz。
但我们仍然应该注意电感选择。 通常、我们会将电感器电流纹波设置在额定电流的40%以内。 然后、我来回顾一下您的原理图。
您好、TI 工程师、
我正在使用 PSpice 监测电流、
如果您知道原因、请告诉我。
测量点是附件中所示的 V1点。
当我更改负载时、电流值不变。
随附的图适用于71Ω 负载、输入电压= 12v、输出电压= 5V。
如果要检测输入电流的平均值、可以添加一些输入布线的非理想电阻器/电感、然后重试。
您好、Athos、
非常感谢。
我了解高侧开关导通时电流会流动。
但是、输入电流(来自 V1的电流)为负、
此外、如果负载电阻为71Ω、
使用以下公式计算输入电流是否正确？
其中不包括损耗。
32.7mA η
V2= 5v
V1= 12v
很抱歉这个基本的问题。
您好、Athos、
通过读取附加图中的光标值、平均值是否正确？
或者有其他方式吗？
尊敬的 Onishi：
为了获取平均值、您可以使用更高的输入电阻、例如1Ohm、并在稳定状态下监控电流。
您好、Athos、
我们也得以在这里复制。
非常感谢。
您好、Athos、
请告诉我、是否有方法或计算公式可以设置 UVLO 检测电压和释放电压之间的迟滞。
在电流仿真中、似乎具有大约2V 的迟滞。
此外、数据表在典型值上显示为200mV。
尊敬的 Onishi：
UVLO 不仅由 VIN 决定、还由 EN 的电压决定、因为 Vin 和 EN 之间有一个分压电阻器。
在仿真中、上升阈值为1/90*(90+470+430)=11V、下降阈值为0.9/90*(90+470+430)=9.9V。
迟滞为1.1V。
要计算 UVLO 迟滞、如果对 EN 使用分压器、则可以使用0.1V / Rbottom *(Rbottom + Rtop)。
如果 EN 保持高电平、则 UVLO 由 Vin 决定、迟滞为200mV。
您好、Athos、
SW 终端的输出是什么？
我们使用 PSpice 仿真器测量了电路板并获得了波形、
的理想占空比。
PSpice 仿真波形显示为47.7%。
在电路板上测得的波形为44.2%。
两次测量的输出电压均为5.1V、
计算出的值为 Vout (5.1)/Vin (12)=41.6%、对吧？
此结果差异是否在正常范围内？
尊敬的 Onishi：
SW 的输出是降压输出的 PWM。
实际上、duty=[Vout + Iout *(电感器_DCR + Rdson)]/ Vin。 该值高于 Vout (5.1)/Vin (12)=41.6%。
您测得的波形是合理的、因为输入在12VDC 下不稳定。 可以看到、当高侧 MOSFET 导通时、SW 会出现压降。
在您的仿真中、SW 最大值为10.532V、因此占空比 D=5.1/10.532=48%也是正常的。
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