[参考译文] SN74CBTLV3126：控制逻辑引脚 OE 的正确操作是什么？数据表错误？

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请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

器件型号：SN74CBTLV3126
主题中讨论的其他器件： SN74CBTLV3125

大家好、

数据表8.1概览中是否描述了以下错误？

'当输出使能(OE)输入为高电平时、FET 多路复用器和多路信号分离器被禁用。'

我知道、当它为低电平时、它将被禁用。

此致、

Kenji

0 admin 6 年多前

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Kenji、

对于 SN74CBTLV3126、请使用8.4.1中的真值表、该表规定 OE 输入为逻辑高电平时、器件将一条低阻抗路径从 A 连接到 B

SN74CBTLV3125将是具有相反的真值表的同一器件。

谢谢、

Adam

0 admin 6 年多前

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Quote-San、您好！

感谢您的回答。

我还有一件事要知道。

8.1概览指出、有必要在 Vcc 上拉 OEpin。

另一方面、在9.2.1.2详细设计过程中、建议使用 Vcc 上拉 OE 或使用 GND 下拉 OE。

需要在 SB 电源接通时关闭开关。

我担心开关将在8.1中打开。

我应该如何处理 OEpin？

此致、

Kenji

0 admin 6 年多前

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Kenji、

您可以根据默认的开关状态上拉或下拉 OE 引脚。其目的是防止该引脚悬空并将器件置于未知状态、从而导致过多的电流消耗。

谢谢、

Adam

开关与多路复用器（参考译文帖）(Read Only)