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[参考译文] UCC21710-Q1：UCC21710-Q1 问题

admin
Guru**** 2477065 points
Other Parts Discussed in Thread: UCC21710-Q1

请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/power-management-group/power-management/f/power-management-forum/1552592/ucc21710-q1-issue-of-ucc21710-q1

器件型号：UCC21710-Q1


工具/软件：

尊敬的 TI 团队：

此栅极驱动器 (UCC21710-Q1) 有一个问题、因为当我将栅极驱动器开关到 100V 以上时、我使用栅极驱动器为 1200V MOSFET (AIMCQ120R030M1TXTMA1) 提供栅极脉冲、我观察到栅极驱动器通过获取一些电流自动禁用。 在 100V 以下、我观察到栅极脉冲中的正弦波、我仅在高侧 MOSFET 栅极驱动器上观察到了这个现象。 因此、我禁用了 OC 引脚和 AIN 引脚（拉至 GND）、即使禁用它意味着我没有获得+！5V 和–4V 的任何脉冲。 请给出任何解决方案。 如何操作？我附加了栅极驱动器电路的原理图。

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    TI__Guru**** 2477065 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

    尊敬的 Mohammed：

    感谢您解释详细信息。 原理图看起来整体很好。 我看不到任何重大问题。 是否可以捕获 FLT 期间的波形：

    DESAT、GATE、INP、FLT、请使用高 BW 示波器和探测并尽可能靠近设备探测信号。

    谢谢

    Sasi

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    TI__Guru**** 2477065 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

    尊敬的 Sasikala：

    如前所述、我们观察到以下情况。 请查看相同的内容、告诉我是否有任何更新。
    DESAT：低电平
    GATE (OUTH、OUTL)：低电平
    INP：（高电平：低电平）、符合预期。


    附加工艺路线快照 FYR。

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    TI__Guru**** 2477065 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

    尊敬的 Mohammed：

    我很想看到 FLT 低电平变为实例以及 OUT 和 FLT 之间的延迟。 您能分享示波器屏幕截图吗？

    在提供的布局中、任何元件都没有标识、因此很难 处理、您能否将元件名称与布局共享。

    谢谢

    Sasi